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VSD – 静态时序分析 – II
VLSI – 免费分析您的芯片时序
讲师：Kunal Ghosh
你将学到什么
- 学生将能够花费 0 美元进行真正的全芯片静态时序分析，因为本课程中使用的设计和工具都是开源的
- 学生将能够欣赏开源 EDA 工具（例如本课程中使用的 Opentimer）的强大功能，并帮助为开发做出贡献
- 学生可以利用本课程中的知识和概念轻松探索商业工具
- 管理整个芯片时序签核
要求
- 静态时序分析 – 第 1 部分课程需要完全完成才能开始本课程。没有例外
- 了解物理设计流程和时钟树综合将会有所帮助
描述
在静态时序分析 – 第 1 部分课程中，我们向您介绍了基本和必要的时序检查，例如 cppr、gba、pba 等。在本课程中，我们重点关注使用名为“Opentimer”的开源 sta 工具在实际芯片上应用这些概念。 ‘。要使这个工具发挥作用，需要做大量的功课，但您知道吗，观察并感受这个开源工具的强大功能，您会发现付出的努力是值得的
为什么它的价值？因为，您现在可以在家里以 0 美元的价格分析您的芯片。这不就是我们一直在寻找的自由吗？在我的高级课程（包括这一课程）中，主要重点是如何使用 Opentimer 分析 USB 控制器或 DDR 等复杂芯片。
Opentimer 由美国伊利诺伊州伊利诺斯大学香槟分校 (UIUC) 的 Tsung-Wei Huang 和 Martin DF Wong 教授开发。它支持 PBA、CPPR、基于块的分析等重要功能。
我在本课程中使用此工具来解释 STA 第 1 部分中的概念，以及我们将在本课程中讨论的一些接口分析。
所以，希望您喜欢学习这门课程，就像我们喜欢制作它们一样。
快乐学习！
本课程适合谁：
- 任何已完成静态时序分析 – 第 1 部分课程的人
- 任何具有触发器、门和数字逻辑基础知识的人（已完成 100% 静态时序分析 – 第 1 部分课程已完成）
| 共 30 节课程 • 总时长 4 小时 0 分钟 | |
| 第一章 sta-2 和 opentimer 工具简介 | |
| 1. sta-2 简介 | 3分12秒 |
| 2. OpenTimer 简介，网表定义和 my_run.tcl 创建 | 8分40秒 |
| 第二章 创建 OpenTimer 的约束命令 | |
| 1. 时钟创建和时钟到达时间定义 | 8分23秒 |
| 2. 输入延迟约束，用于接口建立保持分析 | 8分42秒 |
| 3. 时钟摆幅和数据摆幅约束 | 8分22秒 |
| 4. 输出负载和输出延迟约束 | 4分58秒 |
| 第三章 使用OpenTimer工具进行完整的reg2reg分析 | |
| 1. 实际到达时间（AAT）和所需到达时间（RAT）计算基础 | 9分38秒 |
| 2. Slack 计算量，悲观估计（cppr）和工程变更订单（eco） | 12分1秒 |
| 第四章 接口分析 | |
| 1. 界面分析导论 | 9分 |
| 2. 案例1 C2Q和输入的组合延迟已知 | 9分13秒 |
| 3. 案例2 输入波形规格已给出 | 6分54秒 |
| 4. 案例3 设置时间、保持时间和输出组合延迟是已知的 | 7分15秒 |
| 5. 保持固定ECO和案例4输出波形规格已知 | 10分13秒 |
| 6. 案例5 源同步接口建立时序分析 | 8分38秒 |
| 7. 在Opentimer工具中进行源同步接口设置分析 | 7分53秒 |
| 8. 源同步接口保持时间分析 | 5分42秒 |
| 第五章 时钟门控分析 | |
| 1. 时序门控分析介绍 | 6分31秒 |
| 2. 主动高时钟门控分析 | 6分47秒 |
| 3. 低电平时钟门控分析 | 9分44秒 |
| 4. 基于锁存器的时钟门控技术 | 8分9秒 |
| 5. 集成时钟门控单元 (ICG) | 8分45秒 |
| 第六章 异步和数据检查 | |
| 1. 异步复位设计技术的起源 | 9分51秒 |
| 2. 如何重置同步器解决复位撤销问题 | 11分12秒 |
| 3. 数据到数据设置和保持检查 | 6分8秒 |
| 4. 串行和时钟树最小脉冲宽度检查 | 6分6秒 |
| 第七章 闩锁时序和负载摆幅分析 | |
| 1. 正负锁存器行为介绍 | 8分4秒 |
| 2. 带有时钟借位和时间补偿的Reg2Latch路径示例 | 9分56秒 |
| 3. 不同种类的功率介绍 | 8分13秒 |
| 4. （CTS课程代码片段）加载和斜坡相互依赖 | 10分35秒 |
| 第八章 结论 | |
| 1. 结论，致谢以及接下来要做什么！！！ | 1分55秒 |
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