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VLSI 设计和 Verilog 编程:从基础到高级
掌握 VLSI 设计的基础知识并深入研究 Verilog 编程,让数字设计栩栩如生!
讲师:EDUCBA Bridging the Gap
您将学到什么
- VLSI 和 MOSFET 操作的基本概念。
- VLSI 设计和芯片开发的实用方法。
- 数字逻辑设计,包括组合电路和序贯电路。
- 状态机设计和序列检测。
- Verilog 高级编程基础。
- 硬件描述语言(HDL)的实际应用。
探索相关主题
- 超大规模集成电路(VLSI)
- 其他 IT 和软件
- 信息技术与软件
要求
- 对电子和电路有基本了解。熟悉数字逻辑基础知识会有所帮助,但不是强制性的。热衷于学习和试验 VLSI 设计概念。
描述
课程简介:
VLSI(超大规模集成电路)是现代电子技术的核心。本课程提供对 VLSI 设计概念的端到端理解,从 MOSFET 操作到高级 Verilog 编程技术。无论您是寻求了解基础知识的初学者,还是希望扩展技能的专业人士,本课程都提供有关 VLSI 系统和 Verilog 的原理、设计方法和实际应用的详细见解。踏入数字逻辑设计、状态机和硬件描述语言的世界,并准备构建强大且可扩展的电子设计。
第 1 部分:VLSI 和 MOSFET 基础知识
本部分介绍 VLSI 设计的基础知识和 NMOS 晶体管的工作原理。学生将了解 VLSI 系统的基本构成要素,重点了解 MOSFET 的工作原理及其在电子电路设计中的作用。
第 2 部分:增强 MOSFET 操作
深入研究 MOSFET 的增强模式并深入探索其工作特性。学习控制其行为和在实际场景中应用的实用方法。
第 3 节:探索 VLSI 设计领域
探索 VLSI 内的不同领域,包括逻辑设计、模拟设计、设计验证和物理设计。本部分还介绍了 DFT(可测试性设计)、AMS(模拟混合信号)和物理验证过程等高级主题,最后全面概述了芯片设计步骤。
第 4 节:数字逻辑设计基础
本节介绍数字逻辑设计,从基本和通用门开始,进展到 CMOS 逻辑、组合和顺序电路,最后以全加器设计等实际例子结束。
第 5 节:高级数字逻辑设计
本部分在基础知识的基础上,重点介绍 SR 锁存器和 T 触发器等时序电路元件,介绍可编程逻辑器件,并探索 FPGA 基础知识。学生将打下坚实的数字系统设计基础。
第 6 节:状态机和序列检测器
了解状态机(包括 Moore 和 Mealy 模型)及其在检测序列中的应用。本节重点介绍现实世界中的用例,以说明有限状态机 (FSM) 的实用性。
第 7 节:Verilog 编程简介
使用 Verilog 了解硬件描述语言。本节介绍 Verilog 的功能、设计风格、语法基础以及标识符和数字表示在数字设计中的使用。
第 8 节:Verilog 模块和数据结构
了解 Verilog 模块的结构并探索字符串、寄存器和内存元素等关键概念。学习使用 Verilog 编写 D 触发器和行波进位计数器等实用数字组件的代码。
第 9 节:Verilog 中的运算符和时间
掌握 Verilog 运算符和时序控制,包括基于延迟和基于事件的机制。本节包括 Verilog 设计中的程序块、条件语句和时序复杂性的示例。
第 10 节:高级 Verilog 编程
探索高级 Verilog 主题,例如循环语句、阻塞和非阻塞分配以及 RTL 设计示例。本部分最终全面总结了 Verilog 在实际数字系统中的应用。
结论:
本课程弥合了 VLSI 和 Verilog 编程理论与实践之间的差距。到最后,学生将全面了解数字设计原理并获得 Verilog 的实际经验,为他们应对电子和嵌入式系统中的现实挑战做好准备。
本课程适合哪些人:
- 电子工程专业的学生探索 VLSI 设计。
- 半导体和嵌入式系统行业的专业人士。
- 初学者热衷于了解Verilog等硬件描述语言。
- 业余爱好者致力于创造可扩展且实用的数字设计。
| 共 53 节课程 • 总时长 7 小时 54 分钟 | |
| 第一章 MOSFET简介和Nmos工作原理 | |
| 1. Vlsi 介绍 第一部分 | 8分48秒 |
| 2. Vlsi入门部分2 | 10分20秒 |
| 第二章 实用术语与方法论 | |
| 1. 增强模式 | 6分21秒 |
| 2. 增强模式和第二部分继续第一部分 | 9分37秒 |
| 3. 增强模式和第二部分,第二部分 | 11分17秒 |
| 第三章 各种VLSI领域 | |
| 1. 芯片设计步骤 | 9分17秒 |
| 2. 逻辑设计与模拟设计 | 11分59秒 |
| 3. 设计验证和物理设计 | 11分40秒 |
| 4. DFT AMS 和物理验证第一部分 | 8分1秒 |
| 5. DFT AMS和物理验证第二部分 | 6分5秒 |
| 第四章 数字逻辑设计概述 | |
| 1. 基本门电路 | 12分6秒 |
| 2. 通用门 CMOS N 和第一部分 | 7分50秒 |
| 3. 通用门 CMOS N 和第二部分 | 8分43秒 |
| 4. 非CMOS等效 | 8分55秒 |
| 5. 组合逻辑与时序逻辑电路 全加器示例 第一部分 | 9分3秒 |
| 6. 组合电路与时序电路 全加器示例 第二部分 | 8分11秒 |
| 第五章 数字逻辑设计概述 | |
| 1. 主从触发器下降计数器第一部分 | 8分17秒 |
| 2. 主从触发器下降计数器 第二部分 | 4分34秒 |
| 3. Tff 可编程逻辑简介第一部分 | 7分49秒 |
| 4. Tff 可编程逻辑简介第二部分 | 5分40秒 |
| 5. Pla和Pal | 7分32秒 |
| 6. FPGA简介和特性第一部分 | 5分32秒 |
| 7. FPGA 简介 和 特性 第二部分 | 6分39秒 |
| 第六章 数字逻辑设计概述 | |
| 1. 状态机介绍 第一部分 | 8分35秒 |
| 2. 状态机介绍第二部分 | 5分44秒 |
| 3. 状态机示例:摩尔模型第一部分 | 6分6秒 |
| 4. 状态机示例:摩尔模型第二部分 | 9分47秒 |
| 5. 有限状态机检测序列示例 第一部分 | 7分57秒 |
| 6. 有限状态机检测序列示例 第二部分 | 7分45秒 |
| 7. 数字逻辑简介Verilog入门 | 11分52秒 |
| 第七章 Verilog编程入门 | |
| 1. Verilog特性设计风格 | 12分56秒 |
| 2. Verilog中的基本标识符 | 10分37秒 |
| 3. Verilog中的数字 | 13分10秒 |
| 第八章 字符串和模块结构在Verilog编程中 | |
| 1. 字符串 寄存器 数据类型 第一部分 | 10分47秒 |
| 2. 字符串 寄存器 数据类型 第2部分 | 9分7秒 |
| 3. 时光记忆模块介绍 | 12分9秒 |
| 4. 模块结构D触发器Verilog代码第一部分 | 7分49秒 |
| 5. 模块结构 D触发器 Verilog 代码 第二部分 | 8分46秒 |
| 6. T触发器纹波进位计数器 第一部分 | 11分35秒 |
| 7. T触发器异步计数器第二部分 | 12分10秒 |
| 第九章 Verilog编程中的操作符 | |
| 1. 基本门实例化 | 12分58秒 |
| 2. Verilog 运算符 第1部分 | 6分34秒 |
| 3. Verilog运算符第二部分 | 7分12秒 |
| 4. 算子续 | 8分10秒 |
| 5. 时序控制在Verilog中的基于延迟 | 9分42秒 |
| 6. 基于延迟的内部分配 | 9分36秒 |
| 第十章 基于事件和循环语句的Verilog编程 | |
| 1. 基于事件的定时控制 第一部分 | 7分5秒 |
| 2. 基于事件的定时控制 第2部分 | 7分54秒 |
| 3. Verilog中的过程块 第一部分 | 7分38秒 |
| 4. Verilog中过程块第2部分 | 8分30秒 |
| 5. 阻塞非阻塞条件语句 | 11分19秒 |
| 6. 循环语句和Rtl示例结论第一部分 | 6分23秒 |
| 7. 循环语句和RTL示例结论第2部分 | 10分11秒 |
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